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[국내기업] [반도체IP상장기업] RTL Design/Verification Engineer
■  기본정보
포지션 [반도체IP상장기업] RTL Design/Verification Engineer
회 사 벤처기업 직 급 과장 ~ 부장
외국어 수준 : 연령/성별 무관
진행절차 서류전형 -> 1차면접 ->2차면접 마감일 채용시
■  상세정보
[직급] Senior급 (정규직)

[주요업무]
• Spec definition, macro/micro 아키텍처 설계, RTL 코딩, simulation and synthesis을 포함한 모듈 개발
• Scripting tool을 사용하여 기존 RTL 블록과 검증 환경을 유지 및 향상
• Software development team과 협업

[자격요건]
1. ASIC/SOC/FPGA 개발 경험
2. Verilog HDL 및 C/C+를 사용한 설계/검증에 대한 전문 지식
3. AMBA AXI와 memory sub-system에 대한 지식
4. RTL simulation, debugging, synthesis, and lint/CDC을 위한 EDA 툴의 기술 보유

[우대사항]
• 아래 개발 경험
 - memory sub-system
 - image signal processing
 - video codec
• Python/Perl 사용 가능자
• SystemVerilog를 사용한 test bench 가능자

[근무지] 강남
■  담당컨설턴트 정보
성 명 이승준대표 이메일 sjlee@careerlimes.com
전 화 휴대폰 010-3265-4007

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서울시 용산구 이태원동 / 서울시 구로구 구로동
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